1、[判断题] Verilog HDL中实数型和字符串型常量是可以综合的。摘要：1、[判断题] Verilog HDL中实数型和字符串型常量是可以综合的。A、错误B、正确 2、[判断题] 有限状态机可以认为是组合逻辑和寄存器逻辑的特殊组合。A、错误B、正确 3、[判断题] 如果只需要在上电和系统错误时进行复位操作，采用异步复位方式比同步复位方式好。A、错误B...
A、错误
B、正确
2、[判断题] 有限状态机可以认为是组合逻辑和寄存器逻辑的特殊组合。A、错误
B、正确
3、[判断题] 如果只需要在上电和系统错误时进行复位操作，采用异步复位方式比同步复位方式好。A、错误
B、正确
4、[判断题] 状态机设计主要包含三个对象：当前状态，次状态和输出逻辑。A、错误
B、正确
5、[判断题] PLD按照可编程的次数分为两类：一次性编程器件和可多次编程器件。A、错误
B、正确
6、[判断题] 目前在数字系统的设计中，主要采用Bottom-UP设计为主。A、错误
B、正确
7、[判断题] SOC是System On Chip,芯片系统的缩写。A、错误
B、正确
8、[多选题] 基于EDA技术的设计中，通常有两种设计思路（）。A、自顶向下
B、自底向上
C、自前向后
D、自后向前
9、[判断题] Verilog HDL支持赋值语句。A、错误
B、正确
10、[判断题] 绝大多数的FPGA器件都基于SRAM查找表结构实现。A、错误
B、正确
11、[判断题] ASIC一般采用全定制方法来实现设计。A、错误
B、正确
12、[判断题] 数据流描述方式多用于组合逻辑电路。A、错误
B、正确
13、[判断题] HDL是一种用文本形式来描述和设计电路的语言。A、错误
B、正确
14、[判断题] 编译型仿真器的仿真速度快，但需要预处理，不能即时修改。A、错误
B、正确
15、[判断题] 不考虑信号时延等因素的仿真称为功能仿真。A、错误
B、正确
16、[判断题] Verilog HDL不支持条件语句。A、错误
B、正确
17、[多选题] 基于FPGA/CPLD器件的数字系统设计流程包括哪些阶段（）。A、设计输入
B、综合
C、布局布线
D、仿真和编程
18、[判断题] 仿真也称模拟，是对所设计电路的功能的验证。A、错误
B、正确
19、[判断题] 对设计而言，采用的描述级别越高，设计越容易。A、错误
B、正确
20、[判断题] Verilog HDL中的常量主要有：整数，实数和字符串A、错误
B、正确
21、[判断题] ISP和专用的编程器是FPGA常用的两种编程方式。A、错误
B、正确
22、[判断题] 反熔丝型开关元件一般用在对可靠性要求较高的军事和航天产品器件上。A、错误
B、正确
23、[判断题] Verilog HDL数据类型是用来表示数字电路中的物理连线、数据存储和传输单元等物理量的。A、错误
B、正确
24、[判断题] 目前常用的硬件描述语言为：Verilog HDL和 VHDL。A、错误
B、正确
25、[多选题] EDA技术发展阶段描述正确的是（）。A、CAD阶段
B、CAE阶段
C、EDA阶段
D、以上都不对
26、[判断题] Verilog HDL中的变量一般分为两种数据类型：net型和variable型。A、错误
B、正确
27、[多选题] 布局布线完成后会产生哪些文件（）。A、芯片资源耗用的报告
B、EDIF
C、延时网表
D、器件编程文件
28、[判断题] 把适配后生成的编程文件装入到PLD器件中的过程称为下载。A、错误
B、正确
29、[判断题] 布局布线为将综合生成的电路逻辑网表映射到具体的目标器件中实现，并产生最终的可下载文件的过程。A、错误
B、正确
30、[判断题] GAL是Generic Array Logic,通用阵列逻辑的缩写。A、错误
B、正确
31、[多选题] 下面哪些是专业提供第三方EDA软件工具的公司（）。A、Cadence
B、Mentor
C、Synopsys
D、Synplicity
32、[判断题] PLA是Programmable Logic Array,可编程逻辑阵列的缩写。A、错误
B、正确
33、[判断题] 综合指的是将较高级抽象层次的设计描述自动转化为较低层次描述的过程。A、错误
B、正确
34、[判断题] 仿真器按对设计语言的不同处理方式分为两类：编译型仿真器和解释型仿真器。A、错误
B、正确
35、[判断题] 用状态机进行设计具有速度快、结构简单、可靠性高等优点。A、错误
B、正确
36、[判断题] 数字设计流程中采用原理图方式适合描述电路的连接关系核接口关系。A、错误
B、正确
37、[判断题] 在EDA设计中一般采用硬件描述语言(HDL)进行电路与系统的描述。A、错误
B、正确
38、[多选题] 常用的综合工具有哪些（）。A、FPGA Express
B、FPGA compiler
C、Synplify Pro
39、[多选题] 常用的集成FPGA/CPLD开发工具有哪些（）。A、MAX plus II
B、Quartus II
C、ISE
D、ispLEVER
40、[判断题] Verilog语言的行为描述语句，如条件语句、赋值语句和循环语句类似于软件高级语言，便于学习和使用。A、错误
B、正确
41、[判断题] Verilog HDL支持循环语句。A、错误
B、正确
42、[判断题] JTAG边界扫描测试技术提供了一种合理而有效的方法，用以对高密度、引脚密集的器件和系统进行测试。A、错误
B、正确
43、[多选题] 综合有哪几种形式()。A、RTL
B、逻辑综合
C、将逻辑门表示转换到版图表示
44、[判断题] Verilog HDL中整数型常量是不可以综合的。A、错误
B、正确
45、[判断题] Verilog语言即适合可综合的电路设计，也可胜任电路与系统的仿真。A、错误
B、正确
46、[判断题] PLD器件内部主要由各种逻辑功能部件和可编程开关构成。A、错误
B、正确
47、[判断题] 数字设计流程中的设计输入的表达方式一般有原理图方式和HDL文本方式两种。A、错误
B、正确
48、[判断题] 时序仿真也叫后仿真。A、错误
B、正确
49、[多选题] TOP-down设计一般分为哪几个层次（）。A、系统级
B、功能级
C、门级
D、开关级
50、[多选题] 状态机常用的编码方式有（）。A、顺序编码
B、格雷编码
C、约翰逊编码
D、一位热码
